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Coleção Digital

Avançada


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Título: IMPLEMENTAÇÃO DE CODEC GOLAY-24 PARA FPGA
Instituição: PONTIFÍCIA UNIVERSIDADE CATÓLICA DO RIO DE JANEIRO - PUC-RIO
Autor(es): LEANDRO PEREIRA DE LIMA E SILVA

Colaborador(es):  MARCO ANTONIO GRIVET MATTOSO MAIA - Orientador
Número do Conteúdo: 19818
Catalogação:  05/07/2012 Idioma(s):  PORTUGUÊS - BRASIL

Tipo:  TEXTO Subtipo:  TRABALHO DE FIM DE CURSO
Natureza:  PUBLICAÇÃO ACADÊMICA
Nota:  Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]:  https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=19818@1
Referência [en]:  https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=19818@2
Referência DOI:  https://doi.org/10.17771/PUCRio.acad.19818

Resumo:
Códigos corretores de erros são peças fundamentais dos sistemas modernos de telecomunicações. Através deles, dados podem ser transmitidos por canais ruidosos sem que erros decorrentes dos ruídos presentes no meio inviabilizem a transmissão. Para sistemas digitais, esses códigos são compostos por um conjunto de bits associados aos dados, transmitidos juntamente com eles. Esses bits contêm propriedades matemáticas que permitem que dado um número limitado de bits errados recebidos, sejamos capazes de detectar erros e, em alguns casos, corrigir esses erros. Quando embutidos em FPGAs (field-programmable gate arrays), um único circuito integrado pode conter a lógica para codificar e/ou decodificar mensagens com códigos corretores de erro além de incluir outras funções particulares à aplicação desejada. Neste trabalho, desenvolvemos um codificador e um decodificador do código binário de Golay estendido em VHDL para implementação em FPGA.

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