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Título: SISTEMA GERADOR DE VIA DE DADOS
Instituição: PONTIFÍCIA UNIVERSIDADE CATÓLICA DO RIO DE JANEIRO - PUC-RIO
Autor(es): ALEXANDRE JOSE REIS SANTORO

Colaborador(es):  REYNALDO SIGILIAO DA COSTA - Orientador
Número do Conteúdo: 14554
Catalogação:  05/11/2009 Idioma(s):  PORTUGUÊS - BRASIL

Tipo:  TEXTO Subtipo:  TESE
Natureza:  PUBLICAÇÃO ACADÊMICA
Nota:  Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]:  https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14554@1
Referência [en]:  https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14554@2
Referência DOI:  https://doi.org/10.17771/PUCRio.acad.14554

Resumo:
Programas de computador já vem sendo utilizados há muito tempo no projeto de circuitos integrados, principalmente para verificação e simulação. Os anos 80 viram surgir os compiladores de silício, novas ferramentas para a geração automática de estruturas e leiautes. O sistema apresentado nesse trabalho permite a geração automática do leiaute de uma via de dados (conjunto de registradores e ALUs) a partir de uma descrição de seu tamanho e componentes. É também apresentado um gerador de leiautes gate matrix com facilidades para posicionamento de terminais, utilizando para a criação das células da biblioteca do gerador de vias. São discutidos também os problemas envolvidos nas diversas etapas de geração, assim como as soluções encontradas.

Descrição Arquivo
CAPA, AGRADECIMENTOS, RESUMO, ABSTRACT, SUMÁRIO E LISTAS  PDF  
CAPÍTULO 1  PDF  
CAPÍTULO 2  PDF  
CAPÍTULO 3  PDF  
CAPÍTULO 4  PDF  
CAPÍTULO 5  PDF  
APÊNDICES  PDF  
REFERÊNCIAS BIBLIOGRÁFICAS  PDF  
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