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A violação de direitos autorais é passível de sanções civis e penais.
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Coleção Digital
Título: FLOATING PRINT PROCESSOR: ANALYSIS AND DEVELOPMENT OF A BINARY FLOATING PRINT UNIT Autor: LUIZ FERNANDO GOMES SOARES
Instituição: PONTIFÍCIA UNIVERSIDADE CATÓLICA DO RIO DE JANEIRO - PUC-RIO
Colaborador(es):
JULIUS CESAR BARRETO LEITE - ADVISOR
Nº do Conteudo: 14086
Catalogação: 08/09/2009 Idioma(s): PORTUGUESE - BRAZIL
Tipo: TEXT Subtipo: THESIS
Natureza: SCHOLARLY PUBLICATION
Nota: Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14086@1
Referência [en]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14086@2
Referência DOI: https://doi.org/10.17771/PUCRio.acad.14086
Resumo:
Título: FLOATING PRINT PROCESSOR: ANALYSIS AND DEVELOPMENT OF A BINARY FLOATING PRINT UNIT Autor: LUIZ FERNANDO GOMES SOARES
Nº do Conteudo: 14086
Catalogação: 08/09/2009 Idioma(s): PORTUGUESE - BRAZIL
Tipo: TEXT Subtipo: THESIS
Natureza: SCHOLARLY PUBLICATION
Nota: Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14086@1
Referência [en]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=14086@2
Referência DOI: https://doi.org/10.17771/PUCRio.acad.14086
Resumo:
The Floating Point Processor is an arithmetic unit designed to be connected to any 8, 16, or 32 bits central processor, providing a suplementar instructio set for the realization of double or simple precision floating point arithmetic operations.
Implemented in order to execute concurrely with the central processor, its use is an alternative to the utilization of sftwere routines, with a cost and time saving. Its uitlizat can result a better performance of some orders of magnitude in the speed of execution of arithmetics operations.
This thesis presents the implementation of a floating point unit, and a thorough study of several arithimetic of these algorithms on several possible architectures.
| Descrição | Arquivo |
| COVER, ACKNOWLEDGEMENTS, RESUMO, ABSTRACT AND SUMMARY |
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| CHAPTER 1 |
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| CHAPTER 2 |
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| CHAPTER 3 |
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| CHAPTER 4 |
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| CHAPTER 5 |
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| CHAPTER 6 |
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| CHAPTER 7 |
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| APPENDICES |
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| REFERENCES |
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