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A violação de direitos autorais é passível de sanções civis e penais.
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Coleção Digital
Título: A SELF-CHECKING MICROCOMPUTER Autor: JORGE MOREIRA DE SOUZA
Instituição: PONTIFÍCIA UNIVERSIDADE CATÓLICA DO RIO DE JANEIRO - PUC-RIO
Colaborador(es):
JEAN CLAUDE LAPRIE - ADVISOR
Nº do Conteudo: 11308
Catalogação: 08/02/2008 Idioma(s): PORTUGUESE - BRAZIL
Tipo: TEXT Subtipo: THESIS
Natureza: SCHOLARLY PUBLICATION
Nota: Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=11308&idi=1
Referência [en]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=11308&idi=2
Referência DOI: https://doi.org/10.17771/PUCRio.acad.11308
Resumo:
Título: A SELF-CHECKING MICROCOMPUTER Autor: JORGE MOREIRA DE SOUZA
Nº do Conteudo: 11308
Catalogação: 08/02/2008 Idioma(s): PORTUGUESE - BRAZIL
Tipo: TEXT Subtipo: THESIS
Natureza: SCHOLARLY PUBLICATION
Nota: Todos os dados constantes dos documentos são de inteira responsabilidade de seus autores. Os dados utilizados nas descrições dos documentos estão em conformidade com os sistemas da administração da PUC-Rio.
Referência [pt]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=11308&idi=1
Referência [en]: https://www.maxwell.vrac.puc-rio.br/colecao.php?strSecao=resultado&nrSeq=11308&idi=2
Referência DOI: https://doi.org/10.17771/PUCRio.acad.11308
Resumo:
The design and realization of a microcomputer for high
security level applications is described.
Erroneous data transmission may be prevented by:
-self - checking circuits
-blocking the computer upon detection of a failure.
The microcomputer is built around the Intel 8080
microprocessor and has the followinf characteristics:
- All the working circuits are tested.
- a card level dragnosis is provided with indication by
panel of the faulty unit, atter computer stop.
- memory detection by parity bits
- 8 I/0 ports.
An evaluation of the number of the envisaged memory is
presented.
| Descrição | Arquivo |
| COMPLETE |
PDF 
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